OSCHINA 社区最新专区文章 |
| Posted: 15 Aug 2021 11:21 PM PDT 在Verilog的建模中，时间尺度和延迟是非常重要的概念，设置好时间尺度和延迟，可以充分模拟逻辑电路发生的各种情况和事件发生的时间点，来评估数字IC设计的各种要求，达到充分评估和仿真的作用。注意延迟语句是不可综合的，只是用来数据建模或仿真。 1. 时间尺度 语法格式： `timescale 10ns/1ns 用关键字 `timescale标识...  |
| Posted: 16 Aug 2021 02:10 AM PDT 对于制造企业来说，MES系统软件的价值可以带动整个企业的活力，其所发挥的作用已经在市场中得到了充分的证明，但同时企业要拥有一款真正适合自己企业的MES系统，不但需要一定的资金投入，还需要人力、物力、管理等方面的全面配合，才可完成。 最让企业头疼的就是在MES软件的选型上，在MES软件实施的整个过程中，所出现的...  |
| Posted: 15 Aug 2021 06:41 PM PDT # day02【Collection、泛型】 ## 目标 - [ ] 能够说出集合与数组的区别 - [ ] 说出Collection集合的常用功能 - [ ] 能够使用迭代器对集合进行取元素 - [ ] 能够说出集合的使用细节 - [ ] 能够使用集合存储自定义类型 - [ ] 能够使用foreach循环遍历集合 - [ ] 能够使用泛型定义集合对象 - [ ] 能够理解泛型上下限 - [ ] ...  |
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